基于DSP的防撞雷达信号采样系统设计

SPORT端口配置为外部同步和外部时钟，DMA传输数据，同步信号高电平有效，每次接收的数据长度为32 bit。ADC串行数据的发送以位时钟的上升沿为基准，且高位在前，所以SPORT端口配置为位时钟的下降沿采集同步信号的状态和数据位的状态，优先接收高位数据。ADC在CONV信号的作用下，将采样的I、Q两路信号由模拟量转换为数字量，并在时钟的作用下串行输出。DSP的SPORT口在同步信号和位时钟的作用下完成32 bit串行数据的接收，并在DSP内部将32 bit的数据转换为两个有效位数为14的数据。
3 实验验证
由DSP的SPORT1端口产生400 kHz的采样同步时钟，对DAC的两个支路同时输入频率为10 kHz、幅度为1 V的同一个正弦信号，用DSP接收32 bit的串行数据，并且在DSP内部将32 bit的数据按照DAC发送数据的顺序转换为两个高14 bit有效的&ldquo大电流电感器工厂;short int”型数据，将采集的数据在DSP程序开发软件Visual DSP++中绘出，得到结果如图5所示。可以看出两路采样的结果完全相同，其频率都为10 kHz，从而验证了采样电路的正确性。

由分析Multisim软件的结果可知，采样电路对低频信号有明显的抑制作用（为低通滤波电路）。为了分析低通滤波的幅频特性，对I/Q支路输入正弦信号，当输入信号频率为6 kHz时，CH0+处正弦信号的峰峰值为1 V，逐渐减小输入正弦信号的频率并同时采样，采样得到各个频率点正弦信号最大值，将信号的频率点和各个频率点采样值相对6 kHz正弦信号采样值的衰减在Matlab中绘出，得到图6。从图中的测量结果知道，采样电路的滤波网络的下限频率为290 Hz。

线性调频连续波雷达的回波需要一个周期才能得到一次结果，数据率较低，对采样的速度要求不是很高。本文设计的采样电路，能够实现视频信号I、Q正交两路信号的同步采样，为后续的雷达信号处理算法奠定了基础。
参考文献
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关于阻容减压电路设计的问题? 本帖最后由 自定义LqT 于 2021-8-19 16:30 编辑 对开关电源方面不太懂，在网上查阅的资料，自己做了个阻容降压电路，能实现AC220到DC3.3V输出，遇到问题，1，似乎刚上电时电压有点不稳，想请教资深工程师们，这电路有什么需要改进的地方吗？可仿真。 能用变压器降压的线路最可靠。 king5555 发表于 2021-8-19 23:40可仿真。 能用变压器降压的线路最可靠。 非常感谢！有几点小疑问，1，200K电阻改成并联的原因,2，如果我需要最大80mA的电流输出，1uf的x电容能实

测量电源各环节功率时碰到的几个问题，望指点。




用fluke功率分析仪测量输入侧（A1+、A1-）输出侧（F1、F2），还有电感两端。表中数据为有效值。试验数据：变压器匝比：5:24






输入电压


输入电

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