嵌入式系统设计方法的演化—从单片机到单片系统
来源： 作者： 发布时间：2016-12-26 09:51:43 浏览量：IP(Intellectual Property)内核模块是一种预先设计好的甚至已经过验证的具有某种确定功能的集成电路、器件或部件。它有几种不同形式。IP内核模块有行为 (behavior)、结构(structure)和物理(physical)3级不同程度的设计，对应有主要描述功能行为的“软IP内核(soft IP core)”、完成结构描述的“固IP内核(firm IP core)”和基于物理描述并经过工艺验证的“硬IP内核(hard IP core)”3个层次。这相当于集成电路(器件或部件)的毛坯、半成品和成品的设计技术。
软IP内核通常是用某种HDL文本提交用户，它已经过行为级设计优化和功能验证，但其中不含有任何具体的物理信息。据此，用户可以综合出正确的 门电路级网表，并可以进行后续结构设计，具有最大的灵活性，可以很容易地借助于EDA综合工具与其他外部逻辑电路结合成一体，根据各种不同的半导体工艺， 设计成具有不同性能的器件。可以商品化的软IP内核一般电路结构总门数都在5000门以上。但是，如果后续设计不当，有可能导致整个结果失败。软IP内核 又称作虚拟器件。
硬IP内核是基于某种半导体工艺的物理设计，已有固定的拓扑布局和具体工艺，并已经过工艺验证，具有可保证的性能。其提供给用户的形式是电路物理结构掩模版图和全套工艺文件，是可以拿来就用的全套技术。
固IP内核的设计深度则是介于软IP内核和硬IP内核之间，除了完成硬IP内核所有的设计外，还完成了门电路级综合和时序仿真等设计环节。一般以门电路级网表形式提交用户使用。
TI，Philips和Atmel等厂商就是通过Intel授权，用其MCS-51的IP内核模块结合自己的特长开发出有个性的与Intel MCS-51兼容的单片机。
常用的IP内核模块有各种不同的CPU(32/64位CISC/RISC结构的CPU或8/16位微控制器/单片机，如8051等)、32 /64位DSP(如 320C30)、DRAM、SRAM、EEPROM、Flashmemory、A/D、D/A、MPEG/JPEG、USB、PCI、 标准接口、网络单元、编译器、编码/解码器和模拟器件模块等。丰富的IP内核模块库为快速地设计专用集成电路和单片系统以及尽快占领市场提供了基本保证。
高频版图布线理论基础 (一) 半导体工艺发展得异常迅速，CMOS运用不仅局限于低频（Low Frequency ）、中频（Intermediate Frequency ）电路中，也运用于高频（Radio Frequence）电路。这种情形说明:我们感兴趣频率的
SSL21082典型应用电路此页面是否是列表页或首页？未找到合适正文内容。
寻saber或PLECS仿真软件本帖最后由chenchengan于2012-3-3109:40编辑
我本来打算学saber或PLECS的，但我发觉，网上根本就没有这两个软件的破解版本。
是说明了这两个软件都不常用吗？我的计划只能一拖再
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