基于FPGA的FIR数字滤波器设计方案
来源： 作者： 发布时间：2016-04-21 06:32:02 浏览量：图1为k 阶FIR数字滤波器的结构框图。
2 FIR 数字滤波器的设计流程
该设计流程主要涉及到Matlab/Simulink、DSPBuilder和Quartus Ⅱ等工具软件的开发设计。整个设计流程，包括从系统描述直至硬件实现，可以在一个完整的设计环境中完成，如图2所示。
（1）Matlab/Simulink 中设计输入，即在Matlab 的Simulink环境中建立一个扩展名为mdl的模型文件，用图形方式调用Altera DSP Builder 和其他Simulink库中的图形模块（Block），构成系统级或算法级设计框图（或称Simulink设计模型）。
（2）利用Simulink的图形化仿真、分析功能，分析此设计模型的正确性，完成模型仿真，也叫系统级仿真。
（3）DSP Builder设计实现的关键一步，通过Signal-Compiler把Simulink的模型文件转化成通用的硬件描述语言Verilog文件。
（4）转换好的Verilog源代码用ModelSim软件进行功能仿真，验证Verilog文件的正确性。接下来的几个步骤是对以上设计产生的Verilog的RTL代码和仿真文件在Quartus Ⅱ工具软件中进行综合、编译适配，生成扩展名为。sof的文件加载到FPGA硬件系统中。
3 FIR 数字滤波器的详细设计
3.1 FIR数字滤波器模块设计与系统级仿真
根据FIR数字滤波器的原理，在Simulink环境下搭建16阶的FIR数字滤波器结构，如图3所示。
在模型的搭建过程中，使用了两个8位的Shift Taps移位寄存器模块对输入信号进行分解，然后根据数字滤波器的原理进行算法计算。
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