空间受限应用的最高功率密度、多轨电源解决方案
来源： 作者： 发布时间：2016-06-15 07:31:46 浏览量：图5. ADP5050对高电流轨使用低开关频率以提高效率，对低电流轨使用高开关频率以缩小电感尺寸
电源时序控制
如图6所示，ADP5050和ADP5052通过四个特性来简化使用FPGA和处理器的应用的电源时序控制：精密使能输入、可编程软启动、电源良好输出和有源输出放电开关。
精密使能输入： 每个稳压器，包括LDO在内，都有一个带0.8 V精密基准电压的使能输入（图6-1）。当使能输入的电压大于0.8 V时，稳压器使能；当该电压小于0.725 V时，稳压器禁用。内部1 MΩ下拉电阻可防止该引脚悬空时发生错误。利用精密使能阈值电压，很容易控制器件内的电源时序，使用外部电源时也一样。例如，降压调节器1设置为5 V时，可以利用一个电阻分压器来设置精确的4.0 V跳变点以使能降压调节器2，依此类推为所有输出设置精确的上电时序。
可编程软启动：软启动电路以可控方式缓慢提高输出电压，从而限制浪涌电流。软启动引脚连接到 VREG时，软启动时间设置为2 ms；在软启动引脚与 VREG和地之间连接一个电阻分压器时，软启动时间可提高至8 ms（图6-2）。为了支持特定启动序列或具有大输出电容的值，可能需要这种配置。软启动的可配置能力和灵活性使大型复杂的FPGA以及处理器能以安全可控的方式上电。
1. 精密使能阈值高于0.8V使能稳压器，低于0.72V（迟滞）则关断稳压器。2. 可编程软启动各通道上的不同软启动可编程为2ms、4ms、8ms。
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