空间受限应用的最高功率密度、多轨电源解决方案
来源： 作者： 发布时间：2016-06-15 07:31:46 浏览量： 
图2. 为基于FPGA的系统供电
考虑具有1路12 V输入和5路输出的FPGA的多轨电源管理常见设计规格：
内核电轨：1.2 V （4 A）
辅助电轨：1.8 V （4 A）
I/O电轨：3.3 V （1.2 A）
DDR存储器电轨：1.5 V （1.2 A）
时钟电轨：1.0 V （200 mA）
典型的分立方案如图3a所示，4个开关稳压器连接到12 V输入轨。一个开关稳压器的输出预调节LDO以降低功耗。另一种方法如图3b所示，使用一个稳压器将12 V输入降压至5 V中间轨，然后再经调节以产生所需的各个电压。该方案的成本较低，但由于采用两级电源转换，效率也较低。在以上两种方案中，各稳压器都必须独立使能，因此，可能需要一个专用电源时序控制器来控制电源的时序。噪声可能也是一个问题，除非所有开关稳压器都能同步以降低拍频。
图3. （a） 分立稳压器设计，（b） 备选分立稳压器设计
集成解决方案实现高效率、小尺寸
将多个降压调节器和LDO集成到单个封装中，可显著缩小电源管理设计的总体尺寸。此外，与传统分立方案相比，智能型集成解决方案具有许多优势。减少分立元件数目可大幅降低设计的成本、复杂度和制造成本。集成电源管理单元（PMU）ADP5050 和 ADP5052 可在单个IC中实现所有这些电压和功能，所用PCB面积和元件大幅减少。
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