基于FPGA的UARTl6550的设计

　　接收模块是发送模块功能的逆序执行。他接收来自外部的串行数据，根据配置去除数据的起始、停止位和奇偶校验位，若出现数据差错则立即产生错误信息。如果没有错误，则将剩余的8位有用数据送入接收FIFO让CPU读取。同样接收模块也可以选择不使用FIFO，这时接收模块就会把8位数据直接送给RBR(Receive Buffer Register)接收缓冲寄存器，再由RBR送给CPU。

　　4结果的验证仿真

　　设计采用VHDL语言在FPGA Advantage平台下编写，并通过Modelsim编译仿真，并且通过ISE下载到电路板上验证，硬件验证FPGA芯片采用Xilinx的Spartan3。XC400PQ208。由于验证UART接收/发送时序必须要有处理器，所以采用在FPGA内部嵌入Xilinx的MicroBlaze软核模拟CPU控制时序，通过FPGA外接的串口实现与计算机串口进行通信。

　　5 结 语

　本文介绍了UARTl6550在可编程逻辑器件FPGA上的实现，并通过实际电路验证了设计的功能，使用FP-GA不仅可以方便地用串口协议与PC机进行串行通信，而且扩展了板级系统的接口功能。应用在可编程器件FPGA内部，可以很大程度地减少电路板的使用面积，并提高系统的稳定性和可编程性。

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