基于FPGA的数字锁相环平台的搭建
来源： 作者： 发布时间：2016-09-07 07:00:42 浏览量：
，ADC的采样频率为
。这种IQ采样过程把ADC的输出数据频谱搬移到
附近。在数字前端模块中，把输入的数据分成I、Q两路，然后数字混频到基带。这个数字混频只是简单的乘上频率为
列，不会产生二次频，因此后续不需要滤波处理。信号处理过程的数学表达式如下，假定ADC的中频输入信号为一简单的正弦波：
ADC的输出为：
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