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基于FPGA的数字锁相环平台的搭建

来源:    作者:    发布时间:2016-09-07 07:00:42    浏览量:

1、AGC的仿真,输入AGC的I、Q两路信号幅度为0.01V Vpp,从仿真图中可用看出AGC输出的幅度为1V Vpp,锁定时间在3ms左右。


图(7)、AGC仿真的输入输出图


2、相位误差以及多普勒频偏的估计的仿真,在仿真中我们设定的多普勒频偏为1kHz,从下图的仿真结果锁定后的相位误差非常小,所得到的多普勒频偏的估计也恰好为1KHz。

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