基于PCI总线的微弱信号采集模块的设计方案

　　在设计PCI9054与本地总线界面电路中，将本地总线界面配置为C模式，即设置MODE［1:0］=00，将MODE0和MODE1管脚接地。在系统上电初始化时，PCI9054根据串行E2PROM界面参数配置内部寄存器，采用2Kb的E2PROM芯片93CS56L来存储PCI9054界面芯片的配置参数。

　　4.FPGA控制逻辑设计

　　FPGA控制模块主要实现对AD采集信号的控制和预处理，以及PCI的界面功能，完成数据的实时采集处理。系统中FPGA选用Xilinx公司的Virtex-4系列芯片XC4VLX25-10SF363I作为设计主控器件，并选择XCF08PVO48C作为配置芯片。

　　FPGA内部逻辑包括控制模块，双口RAM缓冲模块，时钟控制模块，32位加法器模块。

　　其中由控制模块完成对累计次数，AD读写，PCI总线读写，采样时钟转换，加法器等的控制功能。其中时钟转换即实现数采频率100MHz和PCI读数40MHz时钟的转换；累加次数控制是通过上位机软件发送给的，由PCI写时序控制的，由于AD9246为14位转换器，系统数据宽度为32位，所以最大可达218次的累加次数。
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求助：SG3524驱动Nmos本帖最后由jinghui1978于2011-6-1409:11编辑
见图。
电路功能：通过电位器RW1来控制负载RL的电流。
问题：SG3524的1脚有一个反馈信号VF，请问这个信号该怎么取？
说明：我原本是把SG3

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